Entrée analoqique (différentielle)
Type signal
(0/1 = 10 V / 20 mA)
P675.2 (0)
49
u
i
± 10 V
± 20 mA
50
1
2
3
EB2
20 mA
10 V
38
39
40
41
42
Sortie analogique
43
44
45
46
47
48
49
50
51
52
53
54
Vue de l'avant
à l'état monté
2 entrées TOR
51
M
extern
24 V
+
52
P24
aux
53
0
2
24 V
M
extern
54
1
2
24 V
M
extern
1
2
Extension de bornes EB2 n° 2
E/S analogiques et TOR
U953.15 = ___
10 V
= 100 %
Normalis.
20 mA = 100 %
0.00 ... 100.00
P676.2 (1.00)
11 bits + S
200 s
A
x
y [%] =
x [%] * P676.2
D
Lissage
hardware
X498
U953.16 = ___
P684.2 (0)
3
-1
P683.2 (0)
2
K
-1
1
0
U953.17 = ___
1
B5222
5 V
B5223
1
B5224
5 V
B5225
3
Offset
P679.2 (0)
-100.00 ... +100.00 %
P677.2 (0.00)
P678.2 (0)
3
-1
y
2
-1
1
0
Cste de temps
Normalis.
0 ... 10000 ms
-200.00 ... +200.00 V
P685.2 (0)
P686.2 (10.00)
r688.2
x
x
=
y
[V]
*
P686.2
100
%
Lissage
K5212
Signalisation de l'état des
bornes par r673.2 sur PMU
K5213
r673.2
45 43 41 39 54 53
4
5
V2.5
P681.2 (1)
B
B
Cste de temps
0 ... 1000 ms
P680.2 (0)
0
0%
0
-1
1
1
Activation
Inversion signe
Lissage
entrée analog.
Rupture de fil (i
2 mA)
Offset
-10.00 ... +10.00 V
P687.2 (0.00)
=
Uout
[V]
9 bits + S
D
Uout = -10 V ... + 10 V
y
A
U
4 sorties TOR à relais
U953.18 = ___
P674 (0)
.05
B
.06
B
.07
B
.08
B
6
7
Diagramme fonctionnel
fp_mc_Y08_f.vsd
MASTERDRIVES MC
08.01.02
r682.2
K5211
B5221
K5212
+
*
Normalis.
[V]
Offset
[V]
100
%
X499
3
47
2
1
Iout =
I
-20 mA...+ 20 mA
48
38
2
2
39
40
3
2
41
42
4
2
43
44
5
2
45
46
8
- Y08 -