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R&S
RTB2000
12.3.1 Le protocole I²C
Ce chapitre fournit un aperçu des caractéristiques du protocole, du format des don-
nées, des types d'adresses et des possibilités de déclenchement. Pour plus d'informa-
tions, lire le "manuel d'utilisation et spécifications du bus I2C" disponible sur la page
web des manuels NXP à http://www.nxp.com/.
Caractéristiques I²C
Les principales caractéristiques du I²C sont :
Conception deux fils : lignes d'horloge série (SCL) et de données série (SDA)
Communication maître / esclave : le maître génère l'horloge et adresse aux escla-
ves. Les esclaves reçoivent l'adresse et l'horloge. Le maître et les esclaves peu-
vent émettre et recevoir des données.
Schéma d'adressage : chaque esclave est adressable par une adresse unique.
Plusieurs esclaves peuvent être liés et peuvent être adressés par le même maître.
Bit de lecture / écriture : spécifie si le maître lit (=1) ou écrit (=0) les données.
Acquittement : prend place après chaque octet. Le récepteur de l'adresse ou des
données envoi le bit d'acquittement à l'émetteur.
Le R&S RTB2000 prend en charge tous les modes de fonctionnement en termes de
vitesse : haut débit, mode rapide plus, mode rapide, et mode standard.
Transfert de données
Le format d'un message simple I²C (trame) avec 7 bits d'adressage se compose des
parties suivantes :
Condition de démarrage : une pente descendante sur un SDA tandis que le SCL
est à l'état haut
L'adresse 7 bits de l'esclave est soit écrite soit lue
Bit R/W : spécifie si les données sont écrites vers ou lues à partie de l'esclave
Bits d'acquittement ACKnowledge : sont émis par le récepteur de l'octet précédent
si le transfert est réussi
Exception : Pour l'accès en lecture, le maître termine la transmission de données
avec un bit NACK après le dernier octet.
Données : plusieurs octets de données avec un bit ACK après chaque octet
Condition d'arrêt : une pente montante sur un SDA tandis que le SCL est à l'état
haut
Manuel d'utilisation 1333.1611.09 ─ 11
Analyse de bus série
I²C (option R&S RTB-K1)
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