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RIGOL
Décodage parallèle
Le bus parallèle se compose d'une ligne d'horloge et d'une ligne de données. Comme
le montre la figure ci-dessous, CLK est la ligne d'horloge, tandis que Bit0 et Bit1 sont
respectivement le bit 0 et le 1er bit sur la ligne de données. L'oscilloscope
échantillonnera les données de canal sur le front montant, le front descendant ou le
front montant/descendant de l'horloge et jugera chaque point de données (logique
"1" ou "0" logique") en fonction du niveau de seuil prédéfini.
Appuyez sur MATH Decode1 Decoder pour sélectionner "Parallel" et ouvrez
le menu de fonction de décodage parallèle.
1. Appuyez sur Decode pour activer ou désactiver la fonction de décodage.
2. Réglage de la ligne d'horloge (CLK)
Appuyez sur CLK pour sélectionner l'un des canaux (CH1 et CH2) comme
canal d'horloge. Si "OFF" est sélectionné, aucun canal d'horloge n'est réglé.
Appuyez sur Edge pour que l'oscilloscope échantillonne les données de la
voie sur le front montant (
montant/descendant (
sélectionné, l'instrument échantillonnera lorsque les données du canal
sauteront pendant le décodage.
3. Paramètre de ligne de données
Définir la largeur du bus
Appuyez sur Width pour définir la largeur des données du bus parallèle, à
savoir le nombre de bits par trame. La valeur par défaut est 2 et la plage est
de 1 à 2.
Spécifier le canal de données pour chaque bit
Appuyez sur Bit X pour sélectionner le bit qui doit spécifier un canal.
Appuyez sur CH pour spécifier une source de canal parmi CH1 ou CH2.
Chapter 7-2
Figure 7- 1 Décodage parallèle
), le front descendant (
) de l'horloge. Si aucun canal d'horloge n'est
Chapter 7 Décodage du protocole
) ou le front
DS1000Z-E User Guide
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